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Pre-silicon security analysis of RISC-V processors to fault injection attacks

Title: Pre-silicon security analysis of RISC-V processors to fault injection attacks
Authors: Courousse, Damien; Jan, Mathieu
Contributors: Laboratoire Fonctions Innovantes pour circuits Mixtes (LFIM); Université Grenoble Alpes (UGA)-Département Systèmes et Circuits Intégrés Numériques (DSCIN (CEA, LIST)); Laboratoire d'Intégration des Systèmes et des Technologies (LIST (CEA)); Direction de Recherche Technologique (CEA) (DRT (CEA)); Commissariat à l'énergie atomique et aux énergies alternatives (CEA)-Commissariat à l'énergie atomique et aux énergies alternatives (CEA)-Direction de Recherche Technologique (CEA) (DRT (CEA)); Commissariat à l'énergie atomique et aux énergies alternatives (CEA)-Commissariat à l'énergie atomique et aux énergies alternatives (CEA)-Laboratoire d'Intégration des Systèmes et des Technologies (LIST (CEA)); Commissariat à l'énergie atomique et aux énergies alternatives (CEA)-Commissariat à l'énergie atomique et aux énergies alternatives (CEA); Laboratoire Environnement de Conception & Architecture (LECA); Université Paris-Saclay-Département Systèmes et Circuits Intégrés Numériques (DSCIN (CEA, LIST)); ANR-22-PECY-0004,ARSENE,ARchitectures SEcurisées pour le Numérique Embarqué(2022); ANR-22-PTCC-0001,PTCC P1,Programme de transfert de compétences et de technologies de la recherche dans le domaine de la cybersécurité – P1(2022); ANR-24-RRII-0004,AUDACE,Expérimentation recherche à risque CEA(2024); European Project: 101095947,HORIZON-KDT-JU-2021-1-IA,HORIZON-KDT-JU-2021-1-IA,TRISTAN(2022)
Source: RISC-V Summit Europe ; https://cea.hal.science/cea-05026003 ; RISC-V Summit Europe, May 2025, paris, France
Publisher Information: CCSD
Publication Year: 2025
Subject Terms: [INFO.INFO-CR]Computer Science [cs]/Cryptography and Security [cs.CR]; [SPI.NANO]Engineering Sciences [physics]/Micro and nanotechnologies/Microelectronics
Subject Geographic: paris; France
Description: International audience ; This talk proposal showcases the sensitivity of processor microarchitectures to fault injection attacks, which threat hardware and software security. As a consequence, security analysis must take into account both the hardware and software models of system under analysis. Furthermore, fault injection requires to consider exhaustively all the possible injection locations, resulting in unprecedented complexity. We present our methodology and two tools developed for this purpose. In particular, our approach has enabled us to identify a new vulnerability in the OpenTitan secure core.
Document Type: conference object
Language: English
Relation: info:eu-repo/grantAgreement//101095947/EU/Together for RISc-V Technology and ApplicatioNs/TRISTAN
Availability: https://cea.hal.science/cea-05026003; https://cea.hal.science/cea-05026003v1/document; https://cea.hal.science/cea-05026003v1/file/main.pdf
Rights: info:eu-repo/semantics/OpenAccess
Accession Number: edsbas.9DCC43F8
Database: BASE